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Toshiba y Western Digital Readying 128 capas 3D NAND Flash


Toshiba y su aliado estratégico Western Digital están preparando una memoria flash NAND 3D de alta densidad de 128 capas. En la nomenclatura de Toshiba, el chip se llamará BiCS-5. Curiosamente, a pesar de la densidad espacial, el chip implementará TLC (3 bits por celda) y no el QLC más reciente (4 bits por celda). Probablemente esto se deba a que los fabricantes de flash NAND todavía están asustados por los bajos rendimientos de los chips QLC. Independientemente, el chip tiene una densidad de datos de 512 Gb. Con un 33% más de capacidad que los chips de 96 capas, los nuevos chips de 128 capas podrían afectar la producción comercial en 2020-21.

El chip BiCS-5 presenta un diseño de 4 planos. Su matriz se divide en cuatro secciones, o planos, a las que se puede acceder de forma independiente; a diferencia de los chips BiCS-4 que usan un diseño de 2 planos. Según se informa, esto duplica el rendimiento de escritura por unidad de canal a 132 MB / s desde 66 MB / s. La matriz también utiliza CuA (circuitos bajo matriz), una innovación de diseño en la que los circuitos lógicos se ubican en la "capa" más baja, con capas de datos apiladas arriba, lo que da como resultado un ahorro del 15 por ciento en la matriz. Aaron Rakers, un analista de mercado de alta tecnología de la industria con Wells Fargo, estima que los rendimientos de Toshiba-WD por cada oblea de 300 mm podrían llegar al 85 por ciento.

Fuente: Blocks & Files


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