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AMD registra la patente Machine Learning Accelerator que se emparejará con el chipset y la Cache

AMD ha presentado una patente en la que describe un diseño de chiplet MLA (Machine Learning Accelerator) que puede ser emparejado con una unidad GPU (como RDNA 3) y una unidad de caché (probablemente una versión exenta de GPU del diseño Infinity Cache de AMD que debutó con RDNA 2) para crear lo que AMD llama un "APD" (Accelerated Processing Device). El diseño permitiría a AMD crear un acelerador de aprendizaje automático basado en chiplets cuya única función sería acelerar el aprendizaje automático, concretamente la multiplicación de matrices. Esto permitiría capacidades no muy diferentes a las disponibles a través de los núcleos Tensor de NVIDIA.



Esto podría dar a AMD una forma modular de añadir capacidades de aprendizaje automático a varios de sus diseños mediante la inclusión de un chip de este tipo, y podría ser la forma en que AMD lograría la aceleración por hardware de una función similar a la de DLSS. Esto evitaría las deficiencias asociadas a su implementación en el propio paquete de la GPU -un aumento del área total de la matriz, con el consiguiente incremento de costes y reducción de rendimientos- y, al mismo tiempo, permitiría a AMD implantarlo en otros productos distintos de los paquetes de la GPU. La patente describe la posibilidad de emplear diferentes tecnologías de fabricación en el diseño basado en chiplets, lo que recuerda a los módulos de E/S de las CPU Ryzen, fabricados mediante un proceso de 12 nm, y no el de 7 nm utilizado para los chiplets del núcleo. La patente también describe la aceleración de las solicitudes de caché desde el chip de la GPU hasta el chiplet de caché, y el uso de éste como caché real o como memoria directamente direccionable.


Fuentes: Free Patents Online, vía Reddit

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