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La hoja de ruta del proceso de Intel se actualiza con planes para volver a la cadencia de dos años

Durante el evento IEDM organizado por la organización IEEE, el CEO de ASML, Martin van den Brink, subió al escenario para elaborar más sobre la visión de ASML del futuro de los semiconductores. Al hablar sobre el futuro de los semiconductores, el Sr. Brink comenzó a hablar sobre Intel y su visión para el futuro. Las diapositivas de Intel mostraban muchas cosas, incluido el respaldo de IP a procesos más antiguos y planean volver a la cadencia de dos años "tick-tock" para restaurar la confianza previa en las capacidades de fabricación de Intel.


Quizás una de las notas más interesantes sobre la presentación es el hecho de que Intel está trabajando arduamente para realizar sus planes de recuperar una cadencia de dos años de realización del proceso "tick-tock". Eso significa que en el futuro, presumiblemente después de que se resuelvan los problemas de debut de 10 nm, Intel quiere hacer el viejo proceso y las tácticas de optimización. Una diapositiva (que se muestra a continuación) titulada "In Moore We Trust" habla mucho sobre los planes futuros de Intel, y muestra algunas cosas en particular: los próximos nodos 10 nm ++ y 10 nm +++ de Intel, y la posibilidad de hacer backport.

Cuando se trata de nodos de 10 nm ++ y 10 nm +++, Intel está mostrando que ya están trabajando en versiones mejoradas de 10 nm + nodos utilizados en chips Ice Lake para que las versiones nuevas y mejoradas de nodos de 10 nm estén listas para frecuencias más altas y un mejor rendimiento . La versión actual de 10 nm + nodo no es muy capaz en cuanto a frecuencia, ya que actualmente solo hay una SKU de Ice Lake que puede alcanzar 4 GHz, mientras que los productos actuales de 14 nm son capaces de alcanzar 5 GHz con facilidad. Se supone que estos nodos próximos abordarán este problema proporcionando transistores más rápidos.

Además, el backporting ahora va a la fabricación de nodos, ya no solo IP. Hasta ahora, Intel habló de backporting como un medio para entregar una nueva IP construida para 10 nm, por ejemplo, a procesos anteriores como 14 nm si es necesario. Sin embargo, la nueva diapositiva muestra la intención de Intel de aplicar técnicas de backporting a un proceso de semiconductores. Por ejemplo, 7 nm pueden ser retroportados a un nodo de 10 nm en forma de 10 nm +++, de modo que todavía oficialmente es de 10 nm según los estándares de Intel, pero presenta mejoras generales del transistor que supuestamente se lanzarían en el nodo de 7 nm.

Intel también está desarrollando nuevos nodos que se lanzarán dentro de diez años. Se muestra arriba el nodo de 1.4 nm, programado para su lanzamiento en 2029 cuando supuestamente se lanzará. Se supone que el nodo de 1,4 nm tiene una densidad de 1,6 mil millones de transistores por milímetro cuadrado, lo que equivale a muchas de las primeras CPU Broadwell de 14 nm. Es inimaginable pensar en tecnologías tan distantes ahora, además, como muestra la hoja de ruta, toda la información que se muestra está sujeta a cambios.

Fuente: WikiChip

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